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橋接器

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橋接器技術

PCI2250 32 位 33MHz PCI 至 PCI 橋接器壓縮 PCI 熱插拔 4 主控方

PCI2250 32 位 33MHz PCI 至 PCI 橋接器壓縮 PCI 熱插拔 4 主控方

德州儀器PCI2250 PCI-to-PCI橋接器在兩個外圍組件互連(PCI)總線之間提供高性能連接路徑。事務發生在一條PCI總線上的主機和另一條PCI總線上的目標之間,PCI2250允許橋接事務在兩條總線上同時發生。網橋支持突發模式傳輸以最大化數據吞吐量,并且通過網橋的兩條總線流量路徑獨立運行。 PCI2250橋接器符合PCI本地總線規范,可用于通過創建分層總線來克服每個PCI總線10個設備和每個擴展槽一個PCI設備的電氣負載限制。 PCI2250為多達四個輔助總線主控制器提供雙層內部仲裁,并可通過外部輔助PCI總線仲裁器實現。 PCI2250提供緊湊型PCI(CPCI)熱插拔擴展功能,使其成為多功能緊湊型PCI卡的理想解決方案,并使單功能卡適應熱插拔合規性。 PCI2250橋接器符合PCI-to-PCI橋接規范。它可以配置為主接口上的正解碼或減法解碼,并提供幾個額外的解碼選項,使其成為定制PCI應用的理想橋接。包括兩個擴展窗口,PCI2250提供串行和并行端口地址的解碼。 PCI2250符合PCI電源管理接口規范修訂版1.0和1.1。此外,PCI2250還為低功耗移動和對接應用提供PCI CLKRUN橋接支持。 PCI2250旨...

2018-09-05 標簽:SATA接口PCIe 103 0

PCI2060 采用緊湊便于熱插拔 PCI 的異步 32 位 66MHz 9 主 PCI 至 PCI 橋接器

PCI2060 采用緊湊便于熱插拔 PCI 的異步 32 位 66MHz 9 主 PCI 至 PCI 橋接器

德州儀器PCI2060是一款32位異步PCI-to-PCI橋接器,完全符合 PCI本地總線規范< /em>,Revision 2.3和 PCI-to-PCI Bridge Specification ,Revision 1.1。 PCI2060橋接器可使主要和次要總線時鐘完全異步,并支持高達66 MHz的PCI時鐘頻率。 PCI2060橋接架構可配置用于 PCI總線電源接口規范。它可以配置為支持1.0版或1.1版。通過使用1.8 V核心邏輯以及兼容3.3 V和5 V PCI信令環境的通用PCI接口,可實現節能。 PCI2060橋接器允許主要和次要總線同時運行。它為每個方向提供獨立的讀寫緩沖區,并利用流水線架構進行突發數據傳輸。 PCI2060橋接器可以克服每個PCI總線10個設備和每個擴展一個PCI設備的電氣負載限制通過創建分層總線插槽。添加到系統的每個PCI2060橋都會創建一個新的PCI總線。 PCI2060橋接器為多達9個輔助總線主控制器提供雙層內部仲裁,并可通過外部仲裁器實現。 PCI2060橋接器提供符合的CompactPCI熱插拔支持PICMG CompactPCI熱插拔規范,修訂版1.0。 特性 完全支持 PCI本地總線規范,修訂版2.3 完全支持 PCI -to-PCI橋規范,修訂版1.1 完全支持高級...

2018-09-05 標簽:SATA接口PCIe 711 0

PCI2050B PCI 至 PCI 橋接器

PCI2050B PCI 至 PCI 橋接器

德州儀器PCI2050B PCI-to-PCI橋接器提供兩條外圍組件互連(PCI)總線之間的高性能連接路徑,工作在最大總線頻率為66兆赫。事務發生在一個主設備和另一個PCI總線上的目標之間,PCI2050B網橋允許橋接事務在兩個總線上同時發生。網橋支持突發模式傳輸以最大化數據吞吐量,并且通過網橋的兩條總線流量路徑獨立運行。 PCI2050B網橋符合 PCI本地總線規范,并且通過創建分層總線,可以用來克服每個PCI總線10個設備和每個擴展槽一個PCI設備的電氣負載限制。 PCI2050B為多達9個輔助總線主控制器提供雙層內部仲裁,并可通過外部總線仲裁器實現。 CompactPCI?熱插拔擴展PCI功能使PCI2050B橋接器成為多功能的理想解決方案緊湊型PCI卡,并使單功能卡適應熱插拔合規性。 PCI2050B橋接器符合 PCI-to-PCI橋接規范(修訂版1.1)。 PCI2050B橋接器符合 PCI總線電源管理接口規范(修訂版1.1)。 PCI2050B橋接器旨在引領行業節能和數據吞吐量。先進的CMOS工藝可在低至66 MHz的PCI時鐘速率下實現低系統功耗。 特性 兩條32位,66 MHz PCI總線 3.3 V核心邏輯,兼容通用PCI接口>具有3...

2018-09-05 標簽:SATA接口PCIe 208 0

XIO3130 集成 PCI Express? (PCIe) 1:3 4 端口 4 通道分組交換機

XIO3130 集成 PCI Express? (PCIe) 1:3 4 端口 4 通道分組交換機

德州儀器XIO3130交換機是PCI Express×1 3端口扇出交換機。 XIO3130提供單個×1上行端口,同時支持每個方向的完整250 MB /s數據包吞吐量。提供三個可獨立配置的×1下游端口,同時支持每個方向的完整250 MB /s數據包吞吐量。 實現直通架構,以減少與通過PCI傳輸的數據包相關的延遲快遞面料。一旦在進入入口端口的分組的報頭內解碼地址或路由信息,該分組就被引導到出口端口以進行轉發。在出口數據包傳輸開始后檢測到數據包錯誤的情況下,支持使用EDB成幀信號的數據包中毒。 下游端口可配置為支持PCI熱插拔插槽實現。在這種情況下,系統設計人員可能決定使用集成的PCI熱插拔兼容控制器。此功能可通過PCI Express功能結構下的經典PCI配置空間獲得。啟用后,下游端口提供PCI熱插拔標準機制,以應用和斷開插槽或插槽的電源。 電源管理功能包括活動狀態電源管理,PME機制,信標/喚醒協議,和所有傳統的PCI D狀態。啟用ASPM時,每個鏈路在空閑時使用L0和L1狀態自動節省功耗。支持PME消息以及PME_Turn_Off /PME_TO_Ack協議。 啟用時,上游端口支持信標傳輸以及 WAKE 端帶有信號以通過PCI熱插拔事件喚醒...

2018-09-05 標簽:SATA接口PCIe 127 0

XIO2001 PCI Express? (PCIe) 轉 PCI 總線轉換橋接器

XIO2001 PCI Express? (PCIe) 轉 PCI 總線轉換橋接器

XIO2001是一款單功能PCI Express到PCI轉換橋,完全符合 PCI Express到PCI /PCI-X橋接規范,修訂版1.0。對于下游流量,橋接器同時支持最多八個過帳和四個非過帳交易。對于上游流量,同時支持最多六個發布和四個非發布事務。 PCI Express接口完全符合 PCI Express Base Specification ,Revision 2.0。< /p> PCI Express接口支持在每個方向同時以250 MB /s的完整數據包吞吐量運行的×1鏈路。此外,該橋還支持高級錯誤報告,包括 PCI Express Base Specification 中定義的擴展CRC(ECRC)。需要補充固件或軟件才能完全使用這兩種功能。 特性 全×1 PCI Express?吞吐量 完全符合 PCI Express至PCI /PCI-X < br>網橋規范,修訂版1.0 完全符合 PCI Express Base規范,修訂版2.0 完全符合 PCI本地總線規范,修訂版2.3 PCI Express高級錯誤報告功能包括ECRC支持 支持D1,D2,D3 熱和D3 冷 當PCI Express上的數據包活動處于空閑狀態時,使用活動狀態鏈路電源管理可以節省電力L0和L1狀態 喚醒事件和信標支持 包含PCI Express數據的錯誤轉發中毒和PCI總線奇...

2018-09-05 標簽:SATA接口PCIe 201 0

XIO1100 x1 PCI Express PHY

XIO1100 x1 PCI Express PHY

XIO1100是PCI Express。符合PCI Express基本規范修訂版1.1的PHY,通過使用PCI Express的PHY接口中描述的接口的修改版本將PCI Express媒體訪問層(MAC)連接到PCI Express串行鏈路。英特爾公司的架構(也稱為PIPE接口)。 PIPE接口的這一修改版本在本數據手冊中稱為TI-PIPE接口。 TI-PIPE接口是引腳可配置的接口,可配置為16位或一個8位接口。 16位TI-PIPE接口是一個125 MHz 16位并行接口,帶有一個16位輸出總線(RXDATA),由RXCLK輸出提供時鐘時鐘和16位輸入總線(TXDATA),由TXCLK輸入時鐘提供時鐘。兩條總線均使用單數據速率(SDR)時鐘進行時鐘控制,其中數據轉換位于相關時鐘的上升沿。 8位TI-PIPE接口是250 MHz 8位并行接口采用由RXCLK輸出時鐘提供時鐘的8位輸出總線(RXDATA)和由TXCLK輸入時鐘提供時鐘的8位輸入總線(TXDATA)。兩條總線都使用雙倍數據速率(DDR)時鐘進行計時,其中數據轉換在時鐘的上升沿和下降沿。 XIO1100 PHY接口為2.5 Gbps PCI Express串行鏈路,帶有發送差分對(TXP和TXN)和接收差...

2018-09-05 標簽:SATA接口PCIe 112 0

XIO2213B 1 個 PCIe 至 1394b OHCI 主機控制器

XIO2213B 1 個 PCIe 至 1394b OHCI 主機控制器

The TI XIO2213B is a PCIe to PCI translation bridge, where the PCI bus interface is internally connected to a 1394b open host controller/link-layer controller with a 3-port 1394b PHY. The PCIe to PCI translation bridge is fully compatible with the PCI Express to PCI/PCI-X Bridge Specification, Revision 1.0. Also, the bridge supports the standard PCI-to-PCI bridge programming model. The 1394b OHCI controller function is fully compatible with IEEE Std 1394b and the latest 1394 Open Host Controller Interface (OHCI) Specification. The XIO2213B simultaneously supports up to four posted write transactions, four nonposted transactions, and four completion transactions pending in each direction at any time. Each posted write data queue and completion data queue can store up to 8K bytes of data. The nonposted data queues can store up to 128 bytes of data. The PCIe interface supports a ×1 link operating at full...

2018-09-05 標簽:SATA接口PCIe 130 0

XIO2221 PCI Express? 至 1394b OHCI(具有 1 端口 PHY)

XIO2221 PCI Express? 至 1394b OHCI(具有 1 端口 PHY)

The TI XIO2221 is a PCIe to PCI translation bridge, where the PCI bus interface is internally connected to a 1394b open host controller/link-layer controller with a 1-port 1394b PHY. The PCIe to PCI translation bridge is fully compatible with the PCI Express to PCI/PCI-X Bridge Specification, Revision 1.0. Also, the bridge supports the standard PCI-to-PCI bridge programming model. The 1394b OHCI controller function is fully compatible with IEEE Std 1394b and the latest 1394 Open Host Controller Interface (OHCI) Specification. The XIO2221 simultaneously supports up to four posted write transactions, four nonposted transactions, and four completion transactions pending in each direction at any time. Each posted write data queue and completion data queue can store up to 8K bytes of data. The nonposted data queues can store up to 128 bytes of data. The PCIe interface supports a ×1 link operating at full 250...

2018-09-05 標簽:SATA接口PCIe 92 0

SN65DSI86 MIPI? DSI 橋至 eDP

SN65DSI86 MIPI? DSI 橋至 eDP

SN65DSI86 DSI至嵌入式DisplayPort(eDP)橋功能一個雙通道MIPI D-PHY接收器前端配置,此配置中在每個通道上具有4條信道,每條信道的運行速率為1.5Gbps,最大輸入帶寬為12Gbps。該橋接器可解碼MIPI DSI 18bpp RGB666和24bpp RGB888視頻流,并將格式化視頻數據流轉換到具有多達四條信道的DisplayPort,每條信道的運行速率為1.62Gbps,2.16 Gbps,2.43 Gbps,2.7Gbps,3.24Gbps,4.32Gbps或5.4Gbps。 SN65DSI86非常適合每秒60幀的WQXGA,以及等效120fps(高達24bpp)的4K和真正高清(1920×1080)分辨率3D圖形。執行了部分線路緩沖以適應DSI與DisplayPort接口間的數據流不匹配。 SN65DSI86采用符合工業標準的接口技術設計,能夠與多種微處理器兼容,并具有多種電源管理功能,包括面板刷新支持和MIPI定義的超低功耗狀態(ULPS)支持。 SN65DSI86用小外形5mm×5mm MicroStar Junior球柵陣列(BGA)(間距0.5mm)封裝,工作溫度范圍為-40°C到+ 85°C。 本文檔后續部分的SN65DSI86是指SN65DSI86。因此,不論何時使用SN65DSI86,此特定語句或特性僅涉及相應指定...

2018-09-05 標簽:收發器HDMI接口 8 0

SN65DSI84-Q1 汽車類單通道 MIPI? DSI 轉雙鏈路 LVDS 橋接器

SN65DSI84-Q1 汽車類單通道 MIPI? DSI 轉雙鏈路 LVDS 橋接器

SN65DSI84-Q1 DSI轉LVDS橋接器具有一個單通道MIPI D-PHY接收器前端配置,此配置中在每個通道上具有4條信道,每條信道的運行速率為1Gbps,最大輸入帶寬為4Gbps。該橋接器可解碼MIPI DSI 18bpp RGB666和24bpp RGB888視頻流,并將格式化視頻數據流轉換為LVDS輸出(像素時鐘范圍為25MHz至154MHz),從而提供雙鏈路LVDS或單鏈路LVDS(每個鏈路具有4個數據信道)。 SN65DSI84-Q1器件非常適用于每秒幀數(fps)為60的WUXGA(1920×1080),每像素位數(bpp)高達24位。該器件實現了部分線路緩沖以適應DSI與LVDS接口間的數據流不匹配。 SN65DSI84-Q1器件采用小外形10mm×10mm HTQFP (0.5mm間距)封裝,工作溫度范圍為-40oC至+105oC。 特性 適用于汽車電子應用 具有符合AEC-Q100標準的下列結果: 器件溫度等級2:-40°C至105°C的環境運行溫度范圍 器件人體放電模式(HBM)靜電放電(ESD)分類等級3A 器件組件充電模式(CDM)ESD分類等級C6 實現了MIPI D-PHY版本1.00.00物理層前端和顯示屏串行接口(DSI)版本1.02.00 單通道DSI接收...

2018-09-05 標簽:收發器HDMI接口 16 0

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橋接器資訊

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Microchip推出業界首款商用eSPI至LPC橋接器,不會浪費您在原有LPC設備上的投資

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