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采用光线传感与DSP嵌入式技术实现地震加速度信号处理系统设计

引言

ARMDSP作为嵌入式技术应用在地震信号处理系统中,能很好地满足地震加速度计对实时性、高精度以及网络化的要求,因此,利用光线传感基于ARM 和DSP双核微处理器的嵌入式系统设计方案,一方面发挥DSP的快速信号处理能力,且能进行小数运算,提高运算精度,完成地震加速度已调信号的解调和频谱分析;另一方面充分利用ARM丰富的片上系统资源,能实现解调信号及其频谱信息的网络传输和显示,该方案仅通过改变软件无需重构电路就能方便快捷地实现系统升级。

1 系统构成及工作原理

地震加速度计由传感探头、光电转换及信号处理系统构成。传感探头由采用基于3x3耦合的光纤M—z干涉仪和相关机械部分组成。如图1所示,干涉仪的输入端是一只2x2耦合器,输出端是一只3x3耦合器,被测信号加在干涉仪的传感臂上。

采用光线传感与DSP嵌入式技术实现地震加速度信号处理系统设计

干涉仪的两臂光纤分别缠绕在传感头中的上下两个力臂圆?#37319;希?#24403;外部施加振动时,简谐振子施加给信号臂光纤一个纵向的应力,光纤的长度产生变化±△L (应变效应)、光纤芯的直径d产生变化±△d(?#27492;?#25928;应)、纤芯折射率n产生变化±△n(光弹效应),这些变化将导致光纤中光波的相位发生变化。?#27492;?#25928;应相对应变效应和光弹效应造成的相位变化非常小,可以忽?#22278;?#35745;,从而即完成加速度信号对光信号的相位调制。参考臂和信号臂在3x3耦合器内发生十涉,将相位变化转换成光强变化,输出的光强信号经PIN转换为电流信号,输出给信号处理系统,能进行地震加速度信号的解调、频谱分析显示及网络传输控?#39057;取?/p>

2 信号解调原理

对传感系统中的简谐振子进行分析可以得出,光波相位变化 Φ(t)与简谐振子感受的加速度a(t)有如下关系。

采用光线传感与DSP嵌入式技术实现地震加速度信号处理系统设计

式中,E为光纤的杨氏模量;A为光纤的横截面积;为弹簧片刚度系数:为?#34892;?#20809;纤长度;m为简谐振子质量。从(1)式可以看出被测加速度与光相位变化呈线性关系。

在3x3耦合对称情况下,从干涉仪输出的3路电流信号,经I,v变换电路和放大电路后的输出为:

采用光线传感与DSP嵌入式技术实现地震加速度信号处理系统设计

式中,C 、B ( i=1,2,3)分别为3路输出的直流分量和交流增益;为被测信号引起的光相位差。从(2)中解出Φ(t),再结合(1)式就可以得到加速度信号。求解Φ(t)的算法框图如图2所示。

采用光线传感与DSP嵌入式技术实现地震加速度信号处理系统设计

解调输出信号:

采用光线传感与DSP嵌入式技术实现地震加速度信号处理系统设计

结合式(1)和式(3)即可求出加速度a(t)。

3 信号处理的硬件实现

信号处理子系统的原理框图如图3所示。

采用光线传感与DSP嵌入式技术实现地震加速度信号处理系统设计

以ARM(选用飞利浦公司的LPC2214)和DSP(Ti公司的TMS320VC5402)为核?#27169;?#22806;扩信号调理、A/D采集、网络控制及液晶显示模块。以ARM作为系统控制中?#27169;?#25511;制A/D转换器进行地震加速度已调信号的采集,经DSP的HPI接口将数据存储到DSP内部RAM 中。完成解调信号的网络传输控制、实时显示以及TMS320VC5402的HPI引导装载。而DSP主要进行信号运算,完成解调和FFT频谱分析。

LPC2214控制器片内有16 kbits RAM和256 kbitsFLASHl 31.为了便于系统升级,扩展了128 kbits的外部RAM 和2 Mbits的外部FLASH.由于DSP要对大量的数据进?#24615;?#31639;,而内部RAM 空间有限?#19968;?#35201;用于存放?#31995;綹次?#21518;的boot loader程序,所以扩展128 kbits外部RAM.

LPC2214有bank。 bank 4个外部存储器组,而对于图3中的系统设计,ARM扩展的存储器或外部I/O器件有6个。所以利用片选信号CS3、地址线A23、A22、A21和一片138译码器进行地址空间细分,此片外存储器或I/O 器件属于bank,组, 所用地址为0x83000000~0x83ffffff。

3.1 信号调理及A,D采集电路

信号调理最主要目的是为了去除信号中的噪声,使被测电压范围和AD采样范围相匹配以提高采样精度。本系统选用Anolog Device公司的ADA4861—3专用放大芯片。该芯片集成了3路放大器。采用单5 V供电。通过调节外接电阻的阻值可以获得1~1 900的放大增益,输出具有良好的线性度和温度稳定性。由于放大电路集成在芯片中。故减少了噪声的引入。

选择MD芯片主要考虑的性能指标有分辨率、转换速率、输入通道数、信噪比、输出接口等参数。因为所采集的加速度信号频率在1 kHz以内根据奈圭斯特定理采样频率 >2 kHz就能无失真地恢复原信号,输入信号有3路,综合考虑以上因素本系统选用Anolog Device公司生产的AD7655芯片。该芯片支持4路输入(INA1、INA2、INB。、INB2),转换位数达16位,1MSPS的转换速率,单电源+5 V供电,串/并口输出方式,双通道同步采样。采样由A。引脚电平控制,A0=0,INA1/INB1采样同步;A o=1,INA~NB2采样同步问。参考电压 面接2.5 V,分辨率为2×VREF/655 36,约为76-3 V.

3.2 ARM 和DSP的接口电路

ARM 和DSP通过HPI接口进行连接。ARM先向DSP写入控?#35889;鄭?#35774;置工作模式,然后将访?#23454;?#22336;写入地址寄存器(HPIA),再对数据锁存器(HPID)进行读写,即可读出和写入指定的存储单元。主机由两根地址线A 、A 可以寻址到HPI接口的控制寄存器、地址寄存器和数据寄存器[51?#25381;蒆BIL、HCNTL1、HCNTL0区分16位数据的高、低字节。当向HBIL=0的地址写入数据时,表示是第1个字节,向HBIL=I的地址写入数据表示第2个字节。并且在数据?#25442;?#20043;前要设置控制寄存器中的BOB位,指示高地址在前还是低地址在前。这一步在程序初始化时由ARM来完成。DSP的片选信号接主机的nCS2,地址空间属bankz组,即0)【82000000~0x82眦DSP可以通过HINT向主机发出中断信号,通知主机一帧数据处理完毕。主机收到中断信号后读取?#32423;?#30340;DSP内部数据空间中的数据进行显示或网络传输等处理操作。

DSP的引导装载采用HPI方式,中断2信号用于激活HPI自举模式。有两种方式可以用来获取中断2引脚?#31995;?#36755;入信号:①将主机中断HINT与INT2直接相连:②在捕捉到DSP?#27425;?#21521;量后的30个时钟周期内触发一个?#34892;?#30340;外部中断INT2.由于本设计HINT信号用于向主机产生中断信号,所以HPI自举加载采用方式②。注意到在自举加载的开始,HINT引脚会产生一个?#34892;?#30340;中断信号,所以ARM在初始化时要清除这个中断。

3.3 ARM 和DM9Ooo网络控制接口

DM90OOE是Davicom公司生产的以太MAC控制器。支持10/100 Mbps传输速率。电路使用16位总线方式进行控制。即数据总线D。~D。与芯片的SD。~SD。连接,地址线也进行相对应的连接,片选线与芯片的AEN相连。DM9000E 以太网控制器的基地址为Ox300。而总线的地址线A 与芯片的命令/数据使能端CMD相连,所以对其进行操作的地址是0x300(地址端口)和0x304(数据端口),而结合ARM 的片选线得到的32位地址为0x83000300 (地址端口)和0x83000304(数据端口)。

4 系统软件设计

传统的嵌入式系统软件设计中,由于广泛采用单任务顺序机制因而编?#35848;?#26434;。同时系统安全性差而导致系统频?#22791;次?#20197;至无法达到设计目标。本设计在软件设计中引入tzCOS—II实时操作系统,使程序设计变得非常简单,将操作系统移植到LPC2214中以提高系统实时性。

首先编写好与硬件接口的驱动程序。应用层程序以任务为编程对象。任务具有任务堆栈、优先级等参数,根据任务的执行顺序和重要程度可分配不同的优先级;在任务调度过程中可以通过OSTaskSuspend(os PRIO—SELF)、OSTaskResume(task_prio)函数进行任务之间的切换。本系统可分为DSP boot loader、 D采集、读HPI、写HPI、网络传输、液晶显示等6大任务。在主函数中创建任务,设置任务各项参数。主程序流程图如图4所示。

采用光线传感与DSP嵌入式技术实现地震加速度信号处理系统设计

5 实验结果及分析

用丹麦产PM4808型振动台模拟产生地震信号,将光纤传感器输出信号输入到本系统进行解调及频谱分析网络传输测试实验,解调实验结果分别如图5所示。

采用光线传感与DSP嵌入式技术实现地震加速度信号处理系统设计

从图5可以看出,系统能较准确地解调出原始信号,其误差主要有光纤传感耦合器的?#23884;?#31216;、A/D量化误差、模拟电路中残留的热噪声干扰等等。

采用光线传感与DSP嵌入式技术实现地震加速度信号处理系统设计

图6所示为网络数据包的传输情况。其中PC机的IP地址设置为192.168.0.4,本设计系统的IP地址设置为192.168.0.7,端*为10000.实验证明所设计的嵌入式信号处理系统可以实现基于TCP/IP的网络通信。

6 结语

本文设计的双CPU光纤传感地震加速度信号处理系统能实时地完成信号解调、频谱分析及其网络传输,系统灵敏度达4.35 V/g,支持10/100 Mbps速?#23454;?#20197;太网传输,其提供网络控制接口对于实现传感器网络化、数据共享、远程监控等具有重要意义采用双CPU的处理方案,实现了对光纤传感地震加速度信号的高精度采集和快速处理,并具有以太网传输功能,实现了地震加速度数据的共享。


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未来性能增长需?#35272;导?#26500;上改变 因此需要用FPGA进行人工智能硬件加速

摩尔定律从2003年开始放缓。为了?#26377;?#24615;能?#23545;觥?#21151;耗减半,Intel CPU采用多核来实现。然而,到....
发表于 01-14 13:58 ? 153次 阅读
未来性能增长需?#35272;导?#26500;上改变 因此需要用FPGA进行人工智能硬件加速

带您完全掌握Android嵌入式智能硬件开发!硬件电路图、项目源码100%完全开源!

参与Android嵌入式开发众筹,可获得以下随项目附赠内容: 1. 《Android嵌入式Li....
发表于 01-14 11:34 ? 0次 阅读
带您完全掌握Android嵌入式智能硬件开发!硬件电路图、项目源码100%完全开源!

基于ARM的Layerscape系列及I.MX系列处理器开发套件

各大互联网巨头在云计算的领域争的头破血流的时候,在IoT领域逐渐开始兴起一种更为靠近物或数据源头的最....
的头像 周立功单片机 发表于 01-14 10:35 ? 1082次 阅读
基于ARM的Layerscape系列及I.MX系列处理器开发套件

ARM和华为在1月初给我们带来哪些新品发布?

2019年注定是不平静的一年,科技届刚刚迎来CES2019的多家产品发布,但是?#25381;?#22312;CES展上亮相的....
发表于 01-14 10:08 ? 852次 阅读
ARM和华为在1月初给我们带来哪些新品发布?

QY-RK3288嵌入式主板硬件说明书中文版资料免费下载

启扬智能QY-RK3299主板硬件说明书,主板介绍了主板资源、硬件接口以及其功能、主板性能、尺寸结构....
发表于 01-14 08:00 ? 25次 阅读
QY-RK3288嵌入式主板硬件说明书中文版资料免费下载

TMS320F28335若干学习经验合集免费下载

本资料为DSP28335的学习经验分享,其中不仅包含了常见的错误情况以及其解决方法,同时,对于学习的....
发表于 01-14 08:00 ? 36次 阅读
TMS320F28335若干学习经验合集免费下载

AM571X ARM应用处理器的数据手册免费下载

AM571X Sitara ARM应用处理器是为满足现代嵌入式产品的密集处理需求而设计的。AM571....
发表于 01-14 08:00 ? 27次 阅读
AM571X ARM应用处理器的数据手册免费下载

基于ARM架构的MCU选择有窍门

在过去,对任何给定指令集的支持只是选择过程中的一个重要元素,但是由于ARM,指令集的相关性可能已经变....
发表于 01-13 11:11 ? 145次 阅读
基于ARM架构的MCU选择有窍门

System View仿真系统在卫星通信中的应用

通信技术的发展日新月异, 系统也日趋复杂, 因此, 在通信系统的设计研发过程中, 在进行硬件系统实验....
发表于 01-11 15:17 ? 30次 阅读
System View仿真系统在卫星通信中的应用

SystemView如何在通信系统仿真中应用?#33455;?#20998;析概述

介绍了通信系统仿真和仿真专用工具SystemView,分析了CNI(Communication、Na....
发表于 01-11 15:17 ? 28次 阅读
SystemView如何在通信系统仿真中应用?#33455;?#20998;析概述

TI DSP集成开发环境CCS的使用资料说明

CCS是TI公?#23601;?#20986;的用于开发DSP芯片的集成开发环?#24120;?#23427;采用Windows风格界面,集编辑、编译、....
发表于 01-11 14:43 ? 45次 阅读
TI DSP集成开发环境CCS的使用资料说明

嵌入式教材ARM系列处理器应用技术完全手册PDF版免费下载

ARM(Advanced RISC Machines)有三种含义,它是一个公司的名称,是一类微处理器....
发表于 01-10 16:50 ? 80次 阅读
嵌入式教材ARM系列处理器应用技术完全手册PDF版免费下载

TMS320VC5506 TMS320VC5506 Fixed-Point Digital Signal Processor

TMS320VC5506定点数字信号处理器(DSP)基于TMS320C55x DSP生成CPU处理器内核。 C55x™DSP架构通过增加并行性和全面关注降低功耗来实现高性能和低功耗。 CPU支持内部总线结构,该结构由一个程序总线,三个数据读总线,两个数据写总线以及专用于外设和DMA活动的附加总线组成。这些总线能够在一个周期内执行最多三次数据读取和两次数据写入。并行地,DMA控制器每个周期最多可以执行两次数据传输,与CPU活动无关。 C55x CPU提供两个乘法累加(MAC)单元,每个单元能?#24674;?#25345;17位x 17-单个循环中的位乘法。额外的16位ALU支持中央40位算术/逻辑单元(ALU)。 ALU的使用受指令集控制,提供优化并行活动和功耗的能力。这些资源在C55x CPU的地址单元(AU)和数据单元(DU)中进行管理。 C55x DSP代支持可变字节宽度指令集,以提高代码密度。指令单元(IU)从内部或外部存储器执行32位程序提取,并为程序单元(PU)排队指令。程序单元解码指令,将任务指向AU和DU资源,并管理完全受保护的管道。预测分支功能可避免执行条件指令时的管道冲?#30784;? 5506?#31995;?28...
发表于 10-17 14:24 ? 7次 阅读
TMS320VC5506 TMS320VC5506 Fixed-Point Digital Signal Processor

TMS320C6747 定点/浮点数字信号处理器

TMS320C6745 /6747器件是一款基于TMS320C674x DSP内核的低功耗数字信号处理器。它的功耗显着低于TMS320C6000 DSP平台的其他成员。 TMS320C6745 /6747器件使原始设备制造商(OEM)和原始设计制造商(ODM)能够快速推出市场?#31995;?#35774;备。高处理性能。 TMS320C6745 /6747 DSP内核采用基于缓存的两级架构。 1级程序高速缓存(L1P)是32 KB直接?#25104;?#39640;速缓存,1级数据高速缓存(L1D)是32 KB双向组关联高速缓存。 2级程序高速缓存(L2P)由256 KB内存空间组成,在程序和数据空间之间共享。 L2内存可以配置为?#25104;?#20869;存,缓存或两者的组合。虽然系统中的其他主机可以访问DSP L2,但是其他主机可以使用额外的128KB RAM共享内存(仅限TMS320C6747),而不会影响DSP性能。 外设集包括:带管理数据输入/输出(MDIO)模块的10/100 Mbps以太网MAC(EMAC);两个I 2 C总线接口; 3个多通道音频串行端口(McASP),带有16/9串行器和FIFO缓冲器;两个64位通用定时器,每个都可配置(一个可配置为看门狗);可配置的16位主机端口接口(HPI)[仅限TMS3...
发表于 10-17 14:20 ? 29次 阅读
TMS320C6747 定点/浮点数字信号处理器

TMS320C6746 TMS320C6746 Fixed/Floating Point DSP

TMS320C6746定点和浮点DSP是一款低功耗应用处理器,该处理器基于C674x DSP内核。该DSP与其他TMS320C6000™平台DSP相比,功耗要小很多。 凭借这款器件,原始设备制造商(OEM)和原始设计制造商(ODM)能够充分利用全集成混合处理器解决方案的灵活性,迅速将兼用稳健操作系统,丰富用户接口和高处理器性能的器件推向市场。 该器件的DSP内核采用基于2级缓存的架构。第1级程序缓存(L1P)是一个 32KB的直接?#25104;?#32531;存,第1级数据缓存(L1D)是一个32KB的2路组相连缓存。第2级程序缓存(L2P)包含256KB的存储空间,由程序空间和数据空间共享.L2存储器可配置为?#25104;?#23384;储器,缓存或二者的组合。系统内的其他主机可以访问DSP L2。 外设集包括:1个具有管理数据输入/输出模块(MDIO)的10Mbps /100Mbps以太网介质访问控制器(EMAC); 1个USB2.0 OTG接口; 2个I 2 C总线接口; 1个具有16个串行器和FIFO缓冲器的多通道音频串行端口(McASP) ); 2个具有FIFO缓冲器的多通道缓冲串行端口(McBSP); 2个可配置的64位通用定时器(其中一个可配置...
发表于 10-15 17:06 ? 51次 阅读
TMS320C6746 TMS320C6746 Fixed/Floating Point DSP

OMAP-L138 OMAP-L138 Data Manual

OMAP-L138 C6000 DSP+ARM 处理器 是一款低功耗 应用 处理器,该处理器基于 ARM926EJ-S 和 C674x DSP 内核。该处理器 与其他 TMS320C6000™ 平台 DSP 相比,功耗要小很多。 凭借这款器件,原始设备制造商 (OEM) 和原始设计制造商 (ODM) 能够充分利用全集成混合处理器解决方案的灵活性,迅速将兼具稳健操作系统、丰富用户接口和高处理器性能的器件推向市场。 此器件采用双内核架构(包括一个高性能的 TMS320C674x DSP 内核和一个 ARM926EJ-S 内核),实现了 DSP 与精简指令集计算机 (RISC) 技术二者优势的完美融合。 ARM926EJ-S 是一款 32 位 RISC 处理器内核,可执行 32 ?#25442;?16 位指令和处理 32 位、16 ?#25442;?8 位数据。该内核采用流水线结构,因此处理器和存储器系统的所有部件能够连续运行。 ARM9 内核配?#34892;?#22788;理器 15 (CP15)、保护模块以及具有页表缓冲区的数据?#32479;?#24207;存储器管理单元 (MMU)。ARM9 内核配有独立的 16KB 指令缓存和 16KB 数据缓存。这两个缓存均与虚拟索引虚拟标签 (VIVT) 4 路相连。ARM9 内核还配...
发表于 10-15 17:04 ? 64次 阅读
OMAP-L138 OMAP-L138 Data Manual

TMS320C6748 TMS320C6748 Fixed/Floating Point DSP

TMS320C6748 定点和浮点 DSP 是一款低功耗 应用 处理器,该处理器基于 C674x DSP 内核。该DSP 与其他 TMS320C6000™ 平台 DSP 相比,功耗要小很多。 凭借这款器件,原始设备制造商 (OEM) 和原始设计制造商 (ODM) 能够充分利用全集成混合处理器解决方案的灵活性,迅速将兼具稳健操作系统、丰富用户接口和高处理器性能的器件推向市场。 该器件的 DSP 内核采用基于 2 级缓存的架构。第 1 级程序缓存 (L1P) 是一个 32KB 的直接?#25104;?#32531;存,第 1 级数据缓存 (L1D) 是一个 32KB 的 2 路组相连缓存。第 2 级程序缓存 (L2P) 包含 256KB 的存储空间,由程序空间和数据空间共享。L2 存储器可配置为?#25104;?#23384;储器、缓存或二者的组合。尽管系统内的其他主机可访问 DSP L2,但还?#23884;?#22806;提供了一个 128KB 的 RAM 共享存储器给其他主机使用,从而避免对 DSP 性能产生影响。 对于支持安全功能的器件,TI 的基本安全启动可为用户保护自主知识产权并防止外部实体修改用户开发的算法。该安全启动流程从一个基于硬件的“信任根”开始,?#32321;?#20195;码从一个已知安全的位置开始...
发表于 10-15 16:19 ? 42次 阅读
TMS320C6748 TMS320C6748 Fixed/Floating Point DSP

TMS320C6720 TMS320C6727B TMS320C6726B TMS320C6722B TMS320C6720 Floating-Point DSPs

The TMS320C672x is the next generation of Texas Instruments' C67x generation of high-performance 32-/64-bit floating-point digital signal processors. The TMS320C672x includes the TMS320C6727B, TMS320C6726B, TMS320C6722B, and TMS320C6720 devices.(1) Enhanced C67x+ CPU. The C67x+ CPU is an enhanced version of the C67x CPU used on the C671x DSPs. It is compatible with the C67x CPU but offers significant improvements in speed, code density, and floating-point performance per clock cycle. At 350 MHz, the CPU is capable of a maximum performance of 2800 MIPS/2100 MFLOPS by executing up to eight instructions (six of which are floating-point instructions) in parallel each cycle. The CPU natively supports 32-bit fixed-point, 32-bit single-precision floating-point, and 64-bit double-precision floating-point arithmetic. Efficient Memory System. The memory controller maps the la...
发表于 10-15 16:17 ? 65次 阅读
TMS320C6720 TMS320C6727B TMS320C6726B TMS320C6722B TMS320C6720 Floating-Point DSPs

TMS320C6727B TMS320C6727B TMS320C6726B TMS320C6722B TMS320C6720 Floating-Point DSPs

The TMS320C672x is the next generation of Texas Instruments' C67x generation of high-performance 32-/64-bit floating-point digital signal processors. The TMS320C672x includes the TMS320C6727B, TMS320C6726B, TMS320C6722B, and TMS320C6720 devices.(1) Enhanced C67x+ CPU. The C67x+ CPU is an enhanced version of the C67x CPU used on the C671x DSPs. It is compatible with the C67x CPU but offers significant improvements in speed, code density, and floating-point performance per clock cycle. At 350 MHz, the CPU is capable of a maximum performance of 2800 MIPS/2100 MFLOPS by executing up to eight instructions (six of which are floating-point instructions) in parallel each cycle. The CPU natively supports 32-bit fixed-point, 32-bit single-precision floating-point, and 64-bit double-precision floating-point arithmetic. Efficient Memory System. The memory controller maps the la...
发表于 10-15 11:08 ? 7次 阅读
TMS320C6727B TMS320C6727B TMS320C6726B TMS320C6722B TMS320C6720 Floating-Point DSPs

SM320C6415-EP 增强?#31570;?#21697;定点数字信号处理器

TMS320C64x ?? DSP(包括SM320C6414-EP,SM320C6415-EP和SM320C6416-EP器件)是TMS320C6000中性能最高的定点DSP产品。 DSP平台。 SM320C64x ?? (C64x ??)设备是基于第二代高性能,先进的VelociTI ??德州仪器(TI)开发的超长指令字(VLIW)架构(VelociTI.2 ??),使这些DSP成为多通道和多功能应用的绝佳选择。 C64x ??是C6000的代码兼容成员?? DSP平台。 C64x器件在500 MHz时钟频率下具有高达4000万条指令/秒(MIPS)的性能,可为高性能DSP编程挑战提供经济高效的解决方案。 C64x DSP具有高速控制器的操作灵活性和阵列处理器的数字功能。 C64x DSP内核处理器有64个32位字长的通用寄存器和8个高度独立的功能单元?? 2个乘法器用于32位结果和6个算术逻辑单元(ALU)??使用VelociTI.2扩展。八个功能单元中的VelociTI.2扩展包括新指令,以加速关键应用程序的性能并扩展VelociTI架构的并行性。 C64x每周期可产生4个32位乘法累加(MAC),总计每秒2400万MAC(MMACS),或每周期8个8位MAC,总计4800 MMACS。 C64x DSP还具有特定于应...
发表于 10-15 11:06 ? 21次 阅读
SM320C6415-EP 增强?#31570;?#21697;定点数字信号处理器

SMJ320C6701-SP ?#29399;?#23556;V类浮点数字信号处理器

SMJ320C67x DSP是SMJ320C6000平台中的浮点DSP系?#23567;?SMJ320C6701('C6701)器件基于德州仪器(TI)开发的高性能,先进的VelociTI超长指令字(VLIW)架构,使该DSP成为多通道和多功能应用的绝佳选择。凭借在140 MHz时钟频率下高达1千兆位每秒浮点运算(GFLOPS)的性能,'C6701为高性能DSP编程挑战提供了经济高效的解决方案。 'C6701 DSP具有高速控制器的操作灵活性和阵列处理器的数字能力。该处理器具有32个32位字长的通用寄存器和8个高度独立的功能单元。八个功能单元提供四个浮点/定点ALU,两个定点ALU和两个浮点/定点乘法器。 'C6701每周期可以产生两个乘法累加(MAC),总计每秒3.34亿MAC(MMACS)。 'C6701 DSP还具有专用硬件逻辑,片上存储器和额外的片上外设。 'C6701包含大量片上存储器,具有强大而多样的设置外围设备。程序存储器由64K字节块组成,用户可配置为高速缓存或存储器?#25104;?#31243;序空间。数据存储器由两个32K字节的RAM块组成。外设集包括两个多通道缓冲串行端口(McBSP),两个通用定时器,一个主机端口接口(HPI)和...
发表于 10-09 15:12 ? 35次 阅读
SMJ320C6701-SP ?#29399;?#23556;V类浮点数字信号处理器

TMS320VC5409A定点c

TMS320VC5409A定点数字信号处理器(DSP)(以?#24405;?#31216;5409A除非另有说明)基于先进的改进型哈佛架构,有一个程序存储器总线和三个数据存储器总线。该处理器提供具有高度并行性的算术逻辑单元(ALU),专用硬件逻辑,片上存储器和其他片上外设。该DSP的操作灵活性和速度的基础是高度专业化的指令集。 独立的程序和数据空间?#24066;?#21516;时访问程序指令和数据,提供高度的并行性。可以在单个周期中执行两个读操作和一个写操作。具有并行存储和特定于应用程序的指令的指令可以充分利用该架构。此外,数据可以在数据?#32479;?#24207;空间之间传输。这种并行性支持一组强大的算术,逻辑和位操作操作,这些操作都可以在一个机器周期中执行。 5409A还包括管理中?#31995;?#25511;制机制, 特性 具有三个独立的16位数据存储器总线和一个程序存储器总线的高级多总线架构 40位算术逻辑单元(ALU)包括一个40位桶形移位器和两个独立的40位累加器 17- \ xD7 17位并行乘法器耦?#31995;?#19968;个40位专用加法器,用于非流水线单周期乘法/累积(MAC)操作 比较,选择和存储单位(CSSU)以进行...
发表于 10-09 11:40 ? 24次 阅读
TMS320VC5409A定点c

SM320VC5510A-EP 增强?#31570;?#21697;定点数字信号处理器

The 320VC5510 (5510) fixed-point digital signal processor (DSP) is based on the TMS320C55x DSP generation CPU processor core. The C55x? DSP architecture achieves high performance and low power through increased parallelism and total focus on reduction in power dissipation. The CPU supports an internal bus structure composed of one program bus, three data-read buses, two-data write buses, and additional buses dedicated to peripheral and DMA activity. These buses provide the ability to perform up to three data reads and two data writes in a single cycle. In parallel, the DMA controller can perform up to two data transfers per cycle independent of the CPU activity. The C55x CPU provides two multiply-accumulate (MAC) units, each capable of 17-bit x 17-bit multiplication in a single cycle. A central 40-bit arithmetic/logic unit (ALU) is supported by an additional 16-bit ALU. Use of the ALUs is under instruc...
发表于 10-09 11:37 ? 48次 阅读
SM320VC5510A-EP 增强?#31570;?#21697;定点数字信号处理器

SM320C6712D-EP 增强?#31570;?#21697;浮点 DSP

320C67x ?? DSP(包括SM320C6712-EP,SM320C6712C-EP,SM320C6712D-EP器件)是浮动的成员TMS320C6000中的点DSP系列?? DSP平台。 C6712,C6712C和C6712D器件基于德州仪器(TI)开发的高性能,先进的超长指令字(VLIW)架构,使这些DSP成为多通道和多功能应用的绝佳选择。 p> C6712C /C6712D器件在时钟频率为167 MHz时性能高达10亿次浮点运算(MFLOPS),是C6000中成本最低的DSP? DSP平台。 C6712C /C6712D DSP具有高速控制器的操作灵活性和阵列处理器的数字能力。该处理器具有32个32位字长的通用寄存器和8个高度独立的功能单元。八个功能单元提供四个浮点/定点ALU,两个定点ALU和两个浮点/定点乘法器。 C6712C /C6712D每个周期可以产生两个MAC,总计300 MMACS。 C6712在时钟频率为100 MHz时性能高达6亿次每秒浮点运算(MFLOPS)。该器件还为高性能DSP编程挑战提供了经济高效的解决方案。 C6712 DSP具有高速控制器的操作灵活性和阵列处理器的数字能力。该处理器具有32个32位字长的通用寄存器和8个高度独立的功能单元。八个...
发表于 10-09 10:35 ? 85次 阅读
SM320C6712D-EP 增强?#31570;?#21697;浮点 DSP

SM320C6711D-EP 增强?#31570;?#21697;浮点 DSP

320C67x ?? DSP(包括SM320C6711-EP,SM320C6711B-EP,SM320C6711C-EP,SM320C6711D-EP器件)撰写TMS320C6000中的浮点DSP系列?? DSP平台。 C6711,C6711B,C6711C和C6711D器件基于德州仪器(TI)开发的高性能,先进的超长指令字(VLIW)架构,使这些DSP成为多通道和多功能应用的绝佳选择。 C6711 /C6711B器件的时钟频率为150 MHz,性能高达每秒9亿次浮点运算(MFLOPS),可为高性能DSP编程挑战提供经济高效的解决方案。 C6711 /C6711B DSP具有高速控制器的操作灵活性和阵列处理器的数字能力。该处理器具有32个32位字长的通用寄存器和8个高度独立的功能单元。八个功能单元提供四个浮点/定点ALU,两个定点ALU和两个浮点/定点乘法器。 C6711 /C6711B每个周期可以产生两个MAC,总计300 MMACS。 在200 MHz或1350 MFLOPS的时钟频率下,每秒浮点运算高达12亿次(MFLOPS) C6711C /C6711D器件的时钟频率为250 MHz(适用于6711D),还为高性能DSP编程挑战提供了经济高效的解决方案。 C6711C /C6711D DSP还具有高速...
发表于 10-09 10:33 ? 10次 阅读
SM320C6711D-EP 增强?#31570;?#21697;浮点 DSP

AM5706 Sitara 处理器:成本经优化的 Arm A15 和 DSP 以及安全引导

AM570x Sitara ARM应用处理器旨在满足现代嵌入式产品对于处理性能的强烈需求。 AM570x器件通过其极具有活性的全集成混合处理器解决方案,可实现较高的处理性能。此外,这些器件还将可编程的视频处理功能与高度集成的外设集完美融合。 可编程性通过单核ARM Cortex-A15 RISC CPU并借助Neon™扩展和TI C66x VLIW浮点DSP内核实现。借助ARM处理器,开发人员能够将控制函数与在DSP和协处理器上编程的其他算法分离其中,TI为ARM和C66x DSP提供了一系列完整的开发工具,其中包括C语言编译器AM570x Sitara ARM应用处理器专为满足现代嵌入式产品的强烈处理需求而打造。 AM570x器件通过集成的混合处理器解决方案的最大灵活性,带来高处理性能。这些器件还将可编程视频处理与高度集成的外设集相结合。 可编程性?#21024;?#26377;Neon™扩展和TI C66x VLIW浮点DSP内核的单核ARM Cortex-A15 RISC CPU提供。 ARM处理器使开发人员能够将控制功能与DSP和协处理器上编程的视觉算法分开,从而降低系统软件的复杂性。 此外,TI还为A...
发表于 10-08 15:30 ? 59次 阅读
AM5706 Sitara 处理器:成本经优化的 Arm A15 和 DSP 以及安全引导

SMJ320C6701 军用浮点数字信号处理器

SMJ320C67x DSP是SMJ320C6000平台中的浮点DSP系?#23567;?SMJ320C6701(?? C6701)器件基于德州仪器(TI)开发的高性能,先进的VelociTI超长指令字(VLIW)架构,使该DSP成为多通道和多功能应用的绝佳选择。 。凭借167 MHz时钟频率,每秒高达1千兆位浮点运算(GFLOPS)的性能,?? C6701为高性能DSP编程挑战提供了经济高效的解决方案。 ?? C6701 DSP具有高速控制器的操作灵活性和阵列处理器的数字能力。该处理器具有32个32位字长的通用寄存器和8个高度独立的功能单元。八个功能单元提供四个浮点/定点ALU,两个定点ALU和两个浮点/定点乘法器。 ?? C6701每周期可以产生两个乘法累加(MAC),总共每秒3.34亿MAC(MMACS)。 ?? C6701 DSP还具有专用硬件逻辑,片上存储器和额外的片上外设。 ?? C6701包含大量片上存储器,具有强大的功能。各种外围设备。程序存储器由64K字节块组成,用户可配置为高速缓存或存储器?#25104;?#31243;序空间。数据存储器由两个32K字节的RAM块组成。外设集包括两个多通道缓冲串行端口(McBSP),两个通用定时器,一个主机端口接口(HPI)和一个无缝外部...
发表于 09-29 11:49 ? 61次 阅读
SMJ320C6701 军用浮点数字信号处理器

AM5K2E02 多核 ARM+DSP

AM5K2E0x是一款基于TI的KeyStone II多核SoC架构的高性能器件,该器件集成了性能最优的Cortex-A15处理器双核或四核CorePac可以高达1.4GHz的内核速度运行.TI的AM5K2E0x器件实现了一套?#23376;?#20351;用的高性能,低功耗平台,可供企业级网络终端设备,数据中心网络,航空电子设备和国防,医疗成像,测试和自动化等诸多应用领域的开发人员使用。 TI的KeyStone II架构提供了一套集成有ARM CorePac,(Cortex-A15处理器四核CorePac),网络处理等各类子系统的可编程平台,并且采用了基于队列的通信系统,使得器件资源能够高效且无缝地运作。这种独特的器件架构中还包含一个TeraNet?#25442;?#26426;,该?#25442;?#26426;可能从可编程内核到高速IO的各类系统元素广泛融合,?#32321;?#23427;们以最高效率?#20013;?#36816;作。 AM5K2E0x KeyStone II器件集成了大量的片上存储ARMD CorePac中多达4个Cortex A15内核共享4MB L2缓存。该器件还集成了2MB的多核共享存储器(每个MSMC),可用作共享的L3 SRAM。所有L2和MSMC存储器均包含错误检测与错误校正功能。该器件包含一个以1600MTPS传输速率运行的64位DDR-3...
发表于 09-29 11:42 ? 0次 阅读
AM5K2E02 多核 ARM+DSP

SMJ320C6201B 定点数字信号处理器,军事

320C6201B DSP是320C6000平台中定点DSP系列的成员。 SM /SMJ320C6201B(C6201B)器件基于德州仪器(TI)开发的高性能,先进的VelociTI超长指令字(VLIW)架构,使该DSP成为多通道和多功能应用的绝佳选择。 。 C6201B的时钟频率为200 MHz,性能高达1.6亿次/秒(MIPS),为高性能DSP编程挑战提供了经济高效的解决方案。 C6201B是C6201的较新版本。 C6201B DSP具有高速控制器的操作灵活性和阵列处理器的数字能力。该处理器具有32个32位字长的通用寄存器和8个高度独立的功能单元。八个功能单元提供六个算术逻辑单元(ALU)以实现高度并行性,两个16位乘法器提供32位结果。 C6201B每个周期可以产生两个乘法累加(MAC) - 总计每秒4亿MAC(MMACS)。 C6201B DSP还具有专用硬件逻辑,片上存储器和其他片上外设。 C6201B包含大量片上存储器,并具有功能强大且多样化的外设集。程序存储器由64K字节块组成,用户可配置为高速缓存或存储器?#25104;?#31243;序空间。 C6201B的数据存储器由两个32K字节的RAM块组成,以提高并发性。外设集包括两个多通道缓冲串行端口(McBSP),两个...
发表于 09-29 11:40 ? 22次 阅读
SMJ320C6201B 定点数字信号处理器,军事

AM5708 Sitara 处理器:成本经优化的 Arm A15 和 DSP,多媒体和安全引导

AM570x Sitara ARM应用处理器旨在满足现代嵌入式产品对于处理性能的强烈需求。 AM570x器件通过其极具有活性的全集成混合处理器解决方案,可实现较高的处理性能。此外,这些器件还将可编程的视频处理功能与高度集成的外设集完美融合。 可编程性通过单核ARM Cortex-A15 RISC CPU并借助Neon™扩展和TI C66x VLIW浮点DSP内核实现。借助ARM处理器,开发人员能够将控制函数与在DSP和协处理器上编程的其他算法分离其中,TI为ARM和C66x DSP提供了一系列完整的开发工具,其中包括C语言编译器AM570x Sitara ARM应用处理器专为满足现代嵌入式产品的强烈处理需求而打造。 AM570x器件通过集成的混合处理器解决方案的最大灵活性,带来高处理性能。这些器件还将可编程视频处理与高度集成的外设集相结合。 可编程性?#21024;?#26377;Neon™扩展和TI C66x VLIW浮点DSP内核的单核ARM Cortex-A15 RISC CPU提供。 ARM处理器使开发人员能够将控制功能与DSP和协处理器上编程的视觉算法分开,从而降低系统软件的复杂性。 此外,TI还为A...
发表于 09-29 11:35 ? 178次 阅读
AM5708 Sitara 处理器:成本经优化的 Arm A15 和 DSP,多媒体和安全引导

SMJ320VC33 数字信号处理器

SMx320VC33 DSP是一款采用0.18μm四电平CMOS(TImeline)技术制造的32位浮点处理器。 SMx320VC33是德州仪器(TI)SM320C3x™系列DSP的一部分。 SM320C3x内部总线和特殊数字信号处理指令集具有高达150 MFLOPS的速度和灵活性。 SMx320VC33通过在其他处理器通过软件或微代码实现的硬件中实现功能?#20174;?#21270;速度。这种硬件密集型方法提供了以前在单个芯片上不可用的性能。 SMx320VC33可以在一个周期内对整数或浮点数据执行并行乘法和ALU运算。每个处理器还拥有通用寄存器文件,程序高速缓存,专用ARAU,内部双访问存储器,支持并发I /O的一个DMA通道以及较短的机器周期时间。这些特征导致高性能和易用性。大地址空间,多处理器接口,内部和外?#21487;?#25104;的等待状态,一个外部接口端口,两个定时器,一个串行端口和多中断结构大大增强了通用应用程序。 SM320C3x支持从主处理器到专用协处理器的各种系统应用程序。通过基于寄存器的架构,大地址空间,强大的寻址模式,灵活的指令集以及良好支持的浮点运算,可轻松实现高级语言支持。 SM /SMJ320VC33是一...
发表于 09-29 11:26 ? 104次 阅读
SMJ320VC33 数字信号处理器

SMJ320VC5416 SMJ320VC5416 定点 DSP

SMJ320VC5416定点数字信号处理器(DSP)(以?#24405;?#31216;5416除非另有说明)基于先进的改进型哈佛架构,有一个程序存储器总线和三个数据存储器总线。该处理器提供具有高度并行性的算术逻辑单元(ALU),专用硬件逻辑,片上存储器和其他片上外设。该DSP的操作灵活性和速度的基础是高度专业化的指令集。 独立的程序和数据空间?#24066;?#21516;时访问程序指令和数据,提供高度的并行性。可以在单个周期中执行两个读操作和一个写操作。具有并行存储和特定于应用程序的指令的指令可以充分利用该架构。此外,数据可以在数据?#32479;?#24207;空间之间传输。这种并行性支持一组强大的算术,逻辑和位操作操作,这些操作都可以在一个机器周期中执行。 5416还包括管理中断,重复操作和函数调用的控制机制。 特性 处理至MIL-PRF-38535(QML) 具有三个独立的16位数据存储器总线的高级多总线架构和一个程序存储器总线 40位算术逻辑单元(ALU),包括一个40位桶形移位器和两个独立的40位累加器 17 x 17位并行乘法器耦合用于非流水线单周期乘法/累加(MAC)操作的40位专用加法器...
发表于 09-29 11:05 ? 50次 阅读
SMJ320VC5416 SMJ320VC5416 定点 DSP
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